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LMK1D1208P

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ピンによる制御機能搭載、8 チャネル出力、1.8V、2.5V、3.3V LVDS バッファ

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LMK1D1208P

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製品詳細

Number of outputs 8 Additive RMS jitter (typ) (fs) 50 Core supply voltage (V) 1.8, 2.5, 3.3 Output supply voltage (V) 1.8, 2.5, 3.3 Output skew (ps) 20 Operating temperature range (°C) -40 to 105 Rating Catalog Output type LVDS Input type HCSL, LP-HCSL, LVCMOS, LVDS, LVPECL
Number of outputs 8 Additive RMS jitter (typ) (fs) 50 Core supply voltage (V) 1.8, 2.5, 3.3 Output supply voltage (V) 1.8, 2.5, 3.3 Output skew (ps) 20 Operating temperature range (°C) -40 to 105 Rating Catalog Output type LVDS Input type HCSL, LP-HCSL, LVCMOS, LVDS, LVPECL
VQFN (RHA) 40 36 mm² 6 x 6
  • 2 入力、8 出力 (2:8) 高性能 LVDS クロック・バッファ・ファミリ
  • 出力周波数：最大 2GHz
  • 個別の出力イネーブル / ディセーブル用ハードウェア・ピン
  • 電源電圧：1.8V / 2.5V / 3.3V ±5%
  • 小さい付加ジッタ：156.25MHz 時、12kHz～20MHz の範囲で最大 60fs rms

    • 非常に小さい位相ノイズ・フロア：-164dBc/Hz (標準値)

  • 非常に小さい伝搬遅延：575ps (最大値)

  • 出力スキュー：20ps (最大値)

  • フェイルセーフ入力
  • ユニバーサル入力は LVDS、LVPECL、LVCMOS、HCSL、CML の信号レベルに対応
  • LVDS リファレンス電圧 V AC_REF は、容量性結合入力に使用可能
  • 産業用温度範囲：-40℃～105℃
  • パッケージ：
    • 6mm × 6mm、40 ピン VQFN (RHA)
  • 2 入力、8 出力 (2:8) 高性能 LVDS クロック・バッファ・ファミリ
  • 出力周波数：最大 2GHz
  • 個別の出力イネーブル / ディセーブル用ハードウェア・ピン
  • 電源電圧：1.8V / 2.5V / 3.3V ±5%
  • 小さい付加ジッタ：156.25MHz 時、12kHz～20MHz の範囲で最大 60fs rms

    • 非常に小さい位相ノイズ・フロア：-164dBc/Hz (標準値)

  • 非常に小さい伝搬遅延：575ps (最大値)

  • 出力スキュー：20ps (最大値)

  • フェイルセーフ入力
  • ユニバーサル入力は LVDS、LVPECL、LVCMOS、HCSL、CML の信号レベルに対応
  • LVDS リファレンス電圧 V AC_REF は、容量性結合入力に使用可能
  • 産業用温度範囲：-40℃～105℃
  • パッケージ：
    • 6mm × 6mm、40 ピン VQFN (RHA)

LMK1D1208P クロック・バッファは、2 つのクロック入力 (IN0 および IN1) のいずれか 1 つを 8 ペアの差動 LVDS クロック出力 (OUT0～OUT7) に分配します。このとき、クロック分配のスキューを最小限に抑えます。入力は LVDS、LVPECL、LVCMOS、HCSL、CML のいずれかに対応可能です。

LMK1D1208P は、50Ω 伝送経路の駆動に特化して設計されています。シングルエンド・モードで入力を駆動する場合は、未使用の負入力ピンに適切なバイアス電圧を印加する必要があります ( 参照)。IN_SEL ピンは、どの入力を出力に転送するかを選択します。このデバイスは、フェイルセーフ入力機能をサポートしています。さらに、このデバイスは入力ヒステリシスを備えており、入力信号が存在しないときに出力がランダムに発振することを防止します。

各 LVDS 差動出力は、対応する OEx ピンをロジック HIGH 「1」に設定するとイネーブルになります。このピンがロジック LOW 「0」に設定されている場合、出力がディセーブルされて HIGH Z 状態になり、消費電力の低減につながります。

このデバイスは、1.8V、2.5V または 3.3V 電源で動作し、-40℃～105℃ (周囲温度) で動作が規定されています。

LMK1D1208P クロック・バッファは、2 つのクロック入力 (IN0 および IN1) のいずれか 1 つを 8 ペアの差動 LVDS クロック出力 (OUT0～OUT7) に分配します。このとき、クロック分配のスキューを最小限に抑えます。入力は LVDS、LVPECL、LVCMOS、HCSL、CML のいずれかに対応可能です。

LMK1D1208P は、50Ω 伝送経路の駆動に特化して設計されています。シングルエンド・モードで入力を駆動する場合は、未使用の負入力ピンに適切なバイアス電圧を印加する必要があります ( 参照)。IN_SEL ピンは、どの入力を出力に転送するかを選択します。このデバイスは、フェイルセーフ入力機能をサポートしています。さらに、このデバイスは入力ヒステリシスを備えており、入力信号が存在しないときに出力がランダムに発振することを防止します。

各 LVDS 差動出力は、対応する OEx ピンをロジック HIGH 「1」に設定するとイネーブルになります。このピンがロジック LOW 「0」に設定されている場合、出力がディセーブルされて HIGH Z 状態になり、消費電力の低減につながります。

このデバイスは、1.8V、2.5V または 3.3V 電源で動作し、-40℃～105℃ (周囲温度) で動作が規定されています。
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技術資料

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* データシート LMK1D1208P ピン制御 OE、低付加ジッタ LVDS バッファ データシート (Rev. A 翻訳版) PDF | HTML 英語版 (Rev.A) PDF | HTML 2023年 6月 27日

設計と開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

LMK1D1212EVM — LMK1D1212 低ジッタ、2:12、LVDS ファンアウト バッファの評価基板

LMK1D1212 は、2 個の差動入力と 12 個の LVDS 出力を採用した、高性能で付加ジッタの小さい LVDS クロック バッファです。この評価基板 (EVM) は、LMK1D1212 の電気的性能を実証する設計を採用しています。また、この評価基板 (EVM) を使用して、LMK1Dxxxx ファミリに属する他の 40 ピン デバイスを評価することもできます。LMK1D1212EVM は、最高の性能を達成できるように、複数の 50Ω SMA コネクタと、複数のインピーダンス制御済み 50Ω マイクロストリップ伝送ラインを実装しています。
ユーザー ガイド: PDF | HTML
TI.com で取り扱いなし
シミュレーション・モデル

LMK1DX IBIS Model (Rev. B)

SNAM251B.ZIP (67 KB) - IBIS Model
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設計ツール

PLLATINUMSIM-SW — PLL loop filter, phase noise, lock time, and spur simulation tool

PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.

サポート対象の製品とハードウェア

サポート対象の製品とハードウェア
ダウンロードオプション
シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI を使用すると、内蔵のライブラリを使用して、複雑なミックスド (...)
リクエスト
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
VQFN (RHA) 40 Ultra Librarian
TI の評価基板に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブ拠点
  • アセンブリ拠点

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

サポートとトレーニング

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