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LMX2595

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位相同期機能搭載、JESD204B サポート、20GHz 広帯域 RF シンセサイザ

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製品詳細

Frequency (max) (MHz) 19000 Frequency (min) (MHz) 100 Normalized PLL phase noise (dBc/Hz) -236 1/f noise (10-kHz offset at 1-GHz carrier) (dBc/Hz) -129 Features Flexible ramp generation, Integer-boundary spurs (IBS) removal, Integrated VCO, JESD204B SYSREF, Multi-device sync, Phase adjustment, Wideband Current consumption (mA) 340 Integrated VCO Yes Operating temperature range (°C) -40 to 85 Rating Catalog Lock time (µs) (typ) (s) Loop BW dependent
Frequency (max) (MHz) 19000 Frequency (min) (MHz) 100 Normalized PLL phase noise (dBc/Hz) -236 1/f noise (10-kHz offset at 1-GHz carrier) (dBc/Hz) -129 Features Flexible ramp generation, Integer-boundary spurs (IBS) removal, Integrated VCO, JESD204B SYSREF, Multi-device sync, Phase adjustment, Wideband Current consumption (mA) 340 Integrated VCO Yes Operating temperature range (°C) -40 to 85 Rating Catalog Lock time (µs) (typ) (s) Loop BW dependent
VQFN (RHA) 40 36 mm² 6 x 6
  • 10MHz～20GHz の出力周波数
  • 100kHz オフセットで位相ノイズ -110dBc/Hz (15GHz キャリア使用時)
  • 7.5GHz でのジッタ 45fs rms (100Hz～100MHz)
  • 出力電力をプログラム可能
  • 主な PLL 仕様
    • 性能指数：-236dBc/Hz
    • 正規化 1/f ノイズ：-129dBc/Hz
    • 高い位相検出器周波数
      • 整数モード：400MHz
      • 分数モード：300MHz
    • 32 ビットのフラクショナル N デバイダ
  • プログラマブル入力マルチプライヤによる整数境界スプリアスの解消
  • 複数デバイス間の出力位相の同期
  • 分解能 9ps のプログラム可能な遅延による SYSREF サポート
  • FMCW アプリケーションに対する周波数ランプおよびチャープ生成機能
  • VCOキャリブレーション速度：< 20µs
  • 3.3V 単一電源で動作
  • 10MHz～20GHz の出力周波数
  • 100kHz オフセットで位相ノイズ -110dBc/Hz (15GHz キャリア使用時)
  • 7.5GHz でのジッタ 45fs rms (100Hz～100MHz)
  • 出力電力をプログラム可能
  • 主な PLL 仕様
    • 性能指数：-236dBc/Hz
    • 正規化 1/f ノイズ：-129dBc/Hz
    • 高い位相検出器周波数
      • 整数モード：400MHz
      • 分数モード：300MHz
    • 32 ビットのフラクショナル N デバイダ
  • プログラマブル入力マルチプライヤによる整数境界スプリアスの解消
  • 複数デバイス間の出力位相の同期
  • 分解能 9ps のプログラム可能な遅延による SYSREF サポート
  • FMCW アプリケーションに対する周波数ランプおよびチャープ生成機能
  • VCOキャリブレーション速度：< 20µs
  • 3.3V 単一電源で動作

LMX2595 は、10MHz～20GHz の任意の周波数を生成できる高性能、広帯域シンセサイザです。15GHz を超える周波数には内蔵ダブラーを使います。-236dBc/Hz の性能指数と高い周波数の位相検出器を備えた高性能 PLL により、非常に低い帯域内ノイズと積分ジッタを実現できます。高速 N デバイダにはプリデバイダがないため、スプリアスの振幅と数が大幅に低減されます。整数境界スプリアスを軽減するためのプログラマブル入力マルチプライヤも備えています。

LMX2595 を使用すると、複数のデバイスの出力を同期させることができ、入力と出力の間に確定的な遅延を必要とするアプリケーションにも対応できます。周波数ランプ生成機能は、自動ランプ生成オプション、または最大限の柔軟性を実現する手動オプションを使って、最大 2 セグメントのランプを合成できます。高速キャリブレーション・アルゴリズムにより、20µs 未満で周波数を変更できます。LMX2595 を使用すると、高速データ・コンバータの低ノイズ・クロック源用に設計された SYSREF (JESD204B 規格準拠) の生成および反復をサポートできます。この構成では、基板配線での遅延時間の相違に対応するため、遅延を微調整 (分解能 9ps) できます。

LMX2595の出力ドライバは、15GHzのキャリア周波数で7dBmという高出力を実現します。このデバイスは単一の3.3V電源で動作し、LDOを内蔵しているため、オンボードの低ノイズLDOは不要です。

LMX2595 は、10MHz～20GHz の任意の周波数を生成できる高性能、広帯域シンセサイザです。15GHz を超える周波数には内蔵ダブラーを使います。-236dBc/Hz の性能指数と高い周波数の位相検出器を備えた高性能 PLL により、非常に低い帯域内ノイズと積分ジッタを実現できます。高速 N デバイダにはプリデバイダがないため、スプリアスの振幅と数が大幅に低減されます。整数境界スプリアスを軽減するためのプログラマブル入力マルチプライヤも備えています。

LMX2595 を使用すると、複数のデバイスの出力を同期させることができ、入力と出力の間に確定的な遅延を必要とするアプリケーションにも対応できます。周波数ランプ生成機能は、自動ランプ生成オプション、または最大限の柔軟性を実現する手動オプションを使って、最大 2 セグメントのランプを合成できます。高速キャリブレーション・アルゴリズムにより、20µs 未満で周波数を変更できます。LMX2595 を使用すると、高速データ・コンバータの低ノイズ・クロック源用に設計された SYSREF (JESD204B 規格準拠) の生成および反復をサポートできます。この構成では、基板配線での遅延時間の相違に対応するため、遅延を微調整 (分解能 9ps) できます。

LMX2595の出力ドライバは、15GHzのキャリア周波数で7dBmという高出力を実現します。このデバイスは単一の3.3V電源で動作し、LDOを内蔵しているため、オンボードの低ノイズLDOは不要です。

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技術資料

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設計と開発

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評価ボード

LMX2595EVM — 位相同期と JESD204B に対応した 20GHz 広帯域 RF シンセサイザの評価基板

この評価基板は LMX2595 向けです。このデバイスは、業界初の VCO 内蔵 PLL であり、最大 15GHz の基本 VCO 出力と、ダブラ使用時の最大 20GHz の出力を供給します。業界をリードする PLL FOM (性能指標) は、1/f が -129 dBc/Hz のとき、-236dBc/Hz です。このデバイスは、JESD204B 規格をサポートしており (SYSREF 信号の生成または中継も可能)、高速データ コンバータへのクロック供給に最適です。この EVM の測定時に発生する内部ジッタは、搬送波周波数が 9GHz のときに 50fs (フェムト秒) (...)
ユーザー ガイド: PDF
TI.com で取り扱いなし
評価ボード

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購入先：X-Microwave
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サポート・ソフトウェア

TICSPRO-SW — TICS Pro GUI and Live Programming Tool for Clocking Devices

Texas Instruments clocks and synthesizers (TICS) pro software is used to program the evaluation modules (EVMs) for product numbers with these prefixes: CDC, LMK and LMX. These products include phase-locked loops and voltage-controlled oscillators (PLL+VCO), synthesizers and clocking devices.

サポート対象の製品とハードウェア

サポート対象の製品とハードウェア
ダウンロードオプション
設計ツール

CLOCK-TREE-ARCHITECT — Clock tree architect プログラミング ソフトウェア

Clock tree architect はクロック ツリーの合成ツールであり、開発中システムの要件に基づいてクロック ツリー ソリューションを生成する方法で、お客様の設計プロセスの効率化に貢献します。このツールは、多様なクロック供給製品を収録した包括的なデータベースからデータを抽出し、システム レベルのマルチチップ クロック供給ソリューションを生成します。
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設計ツール

PLLATINUMSIM-SW — PLL loop filter, phase noise, lock time, and spur simulation tool

PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.

サポート対象の製品とハードウェア

サポート対象の製品とハードウェア
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パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
VQFN (RHA) 40 Ultra Librarian
TI の評価基板に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブ拠点
  • アセンブリ拠点

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

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