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DP83848-EP

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エンハンスド製品、PHYTER 極限温度、シングル ポート 10/100Mbps イーサネット物理レイヤ

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製品詳細

Datarate (Mbps) 10/100 Interface type MII, RMII, SNI Rating HiRel Enhanced Product Number of ports Single Features JTAG1149.1 Supply voltage (V) 3.3 I/O supply voltage (typ) (V) 3.3 Operating temperature range (°C) -55 to 125 Number of LEDs 3 ESD HBM (kV) 4
Datarate (Mbps) 10/100 Interface type MII, RMII, SNI Rating HiRel Enhanced Product Number of ports Single Features JTAG1149.1 Supply voltage (V) 3.3 I/O supply voltage (typ) (V) 3.3 Operating temperature range (°C) -55 to 125 Number of LEDs 3 ESD HBM (kV) 4
HLQFP (PTB) 48 81 mm² 9 x 9 HTQFP (PHP) 48 81 mm² 9 x 9
  • 低消費電力の 3.3V、0.18µm CMOS テクノロジ
  • 低消費電力：270mW 未満 (標準値)
  • 3.3V MAC インターフェイス
  • 10/100Mbps の Auto-MDIX
  • エネルギー検出モード
  • 25MHz のクロック出力
  • SNI インターフェイス (構成可能)
  • RMII リビジョン1.2 インターフェイス (構成可能)
  • MII シリアル管理インターフェイス (MDC および MDIO)
  • IEEE 802.3u MII
  • IEEE 802.3u 自動ネゴシエーションおよび並列検出
  • IEEE 802.3u ENDEC、10BASE-T トランシーバおよびフィルタ
  • IEEE 802.3u PCS、100BASE-TX トランシーバおよびフィルタ
  • IEEE 1149.1 JTAG
  • 適応型イコライゼーションおよびベースライン・ワンダー補償機能を備えた ANSI X3.263 準拠 TP-PMD 物理サブレイヤを内蔵
  • 最大 150m のエラーフリー動作
  • プログラム可能な LED：リンク、10/100Mbps モード、アクティビティ、コリジョン検出をサポート
  • 1 回のレジスタ・アクセスで PHY ステータスを取得可能
  • 10/100Mbps パケットの BIST (内蔵自己テスト)
  • 鉛フリー、7mm × 7mm の 48 ピン PQFP パッケージ
  • 低消費電力の 3.3V、0.18µm CMOS テクノロジ
  • 低消費電力：270mW 未満 (標準値)
  • 3.3V MAC インターフェイス
  • 10/100Mbps の Auto-MDIX
  • エネルギー検出モード
  • 25MHz のクロック出力
  • SNI インターフェイス (構成可能)
  • RMII リビジョン1.2 インターフェイス (構成可能)
  • MII シリアル管理インターフェイス (MDC および MDIO)
  • IEEE 802.3u MII
  • IEEE 802.3u 自動ネゴシエーションおよび並列検出
  • IEEE 802.3u ENDEC、10BASE-T トランシーバおよびフィルタ
  • IEEE 802.3u PCS、100BASE-TX トランシーバおよびフィルタ
  • IEEE 1149.1 JTAG
  • 適応型イコライゼーションおよびベースライン・ワンダー補償機能を備えた ANSI X3.263 準拠 TP-PMD 物理サブレイヤを内蔵
  • 最大 150m のエラーフリー動作
  • プログラム可能な LED：リンク、10/100Mbps モード、アクティビティ、コリジョン検出をサポート
  • 1 回のレジスタ・アクセスで PHY ステータスを取得可能
  • 10/100Mbps パケットの BIST (内蔵自己テスト)
  • 鉛フリー、7mm × 7mm の 48 ピン PQFP パッケージ

イーサネット接続を必要とするアプリケーションの数は増え続けています。市場での需要の増大とともに、アプリケーションの要件も変化しつつあります。DP83848-EP は、最も過酷な環境でもイーサネット接続できるよう設計されました。このデバイスは、-55℃～125℃の軍事用温度範囲で IEEE 802.3u 規格を満たします。このデバイスは、航空電子工学、防衛、産業用制御アプリケーションなどの過酷な環境に理想的です。

DP83848-EP は、MPU 選定の柔軟性を最大限に高めることができるように強力な ESD 保護、MII、RMII を 48 ピン PQFP パッケージにすべて統合した堅牢な高信頼性多機能デバイスです。

DP83848-EP は 10BASE-T と 100BASE-TX の両方のイーサネット・プロトコルをサポートするサブレイヤを内蔵しているため、規格に基づく他のすべてのイーサネット・ソリューションとの互換性と相互運用性を確保できます。

イーサネット接続を必要とするアプリケーションの数は増え続けています。市場での需要の増大とともに、アプリケーションの要件も変化しつつあります。DP83848-EP は、最も過酷な環境でもイーサネット接続できるよう設計されました。このデバイスは、-55℃～125℃の軍事用温度範囲で IEEE 802.3u 規格を満たします。このデバイスは、航空電子工学、防衛、産業用制御アプリケーションなどの過酷な環境に理想的です。

DP83848-EP は、MPU 選定の柔軟性を最大限に高めることができるように強力な ESD 保護、MII、RMII を 48 ピン PQFP パッケージにすべて統合した堅牢な高信頼性多機能デバイスです。

DP83848-EP は 10BASE-T と 100BASE-TX の両方のイーサネット・プロトコルをサポートするサブレイヤを内蔵しているため、規格に基づく他のすべてのイーサネット・ソリューションとの互換性と相互運用性を確保できます。
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技術資料

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* データシート DP83848-EP PHYTER軍事用温度仕様のシングル・ポート10/100Mbps イーサネット物理層トランシーバ データシート (Rev. E 翻訳版) PDF | HTML 英語版 (Rev.E) PDF | HTML 2019年 9月 4日
* 放射線と信頼性レポート DP83848MPTBEP Reliability Report 2019年 6月 7日
* VID DP83848-EP VID V6212615 2016年 6月 21日
* 放射線と信頼性レポート DP83848MPHPEP Reliability Report 2013年 1月 7日
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設計と開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

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評価ボード

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ユーザー ガイド: PDF
TI.com で取り扱いなし
ドライバまたはライブラリ

DP83848SW-LINUX — DP83848 向け Linux ドライバ

The Linux driver supports the DP83848 Ethernet physical layer (PHY) device. The Linux driver supports communication through MII/MDIO and registers with the PHY framework of the Linux kernel.

 

Linux mainline status

Available in Linux mainline: Yes
Available through git.ti.com: N/A

Supported Devices:

  • (...)
View Options
評価基板 (EVM) 向けの GUI

DIEP — Debug Interface for Ethernet PHYs (DIEP)

The drivers for Texas Instruments' Ethernet physical layer (PHY) transceivers support communication through the serial management interface (MDC/MDIO) to configure and read PHY registers. Linux and RTOS drivers can be found on our github.

 

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サポート・ソフトウェア

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サポート対象の製品とハードウェア

サポート対象の製品とハードウェア
ダウンロード
シミュレーション・モデル

DP83848I BSDL Model

SNLM178.ZIP (1 KB) - BSDL Model
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部品表 (BOM)

DP83848 MAU Bill of Materials

SNLR023.PDF (59 KB)
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回路図

DP83848 MAU Schematics

SNLR022.PDF (116 KB)
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回路図

DP83848 to Motorola MCF5282 Processor Schematic

SNLR025.ZIP (167 KB)
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回路図

DP83848 to IBM PPC440GP Processor Schematic

SNLR026.ZIP (157 KB)
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回路図

DP83848 to Renesas SH7710 Processor Schematic

SNLR027.ZIP (132 KB)
ダウンロード
シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

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TINA-TI — SPICE ベースのアナログ・シミュレーション・プログラム

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ユーザー ガイド: PDF
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パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
HLQFP (PTB) 48 Ultra Librarian
HTQFP (PHP) 48 Ultra Librarian
TI の評価基板に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブ拠点
  • アセンブリ拠点

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TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

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