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LMK5C22212AS1

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BAW VCO (バルク弾性波電圧制御発振器) 搭載、IEEE-1588 対応、3 個の DPLL (デジタル PLL)、2 個の APLL (アナログ PLL)、2 個の入力と 12 個の出力、ネッ

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製品詳細

Function Clock network synchronizer Number of outputs 16 RMS jitter (fs) 50 Output frequency (min) (MHz) 0.000000000001 Output frequency (max) (MHz) 3000 Input type HCSL, LVCMOS, LVDS, LVPECL, XTAL Output type CML, LVCMOS, LVDS, LVPECL Supply voltage (min) (V) 3.135 Supply voltage (max) (V) 3.465 Features JESD204B Rating Catalog Operating temperature range (°C) -40 to 85 Number of input channels 2
Function Clock network synchronizer Number of outputs 16 RMS jitter (fs) 50 Output frequency (min) (MHz) 0.000000000001 Output frequency (max) (MHz) 3000 Input type HCSL, LVCMOS, LVDS, LVPECL, XTAL Output type CML, LVCMOS, LVDS, LVPECL Supply voltage (min) (V) 3.135 Supply voltage (max) (V) 3.465 Features JESD204B Rating Catalog Operating temperature range (°C) -40 to 85 Number of input channels 2
VQFN (RGC) 64 81 mm² 9 x 9
  • 超低ジッタ BAW VCO ベースの無線インフラとイーサネット クロック
    • 491.52MHz での RMS ジッタ 40fs (標準値) / 57fs (最大値)
    • 245.76MHz での RMS ジッタ 50fs (標準値) / 62fs (最大値)

  • 2 つのアナログ位相ロック ループ (APLL) による 2 つの高性能デジタル位相ロック ループ (DPLL)

    • 1mHz～4kHz にプログラム可能な DPLL ループ フィルタの帯域幅
    • 1ppt 未満の DCO 周波数調整ステップ サイズ
  • 2 差動またはシングルエンド DPLL 入力
    • 入力周波数：1Hz (1PPS) ～ 800MHz
    • デジタル Holdover および Hitless Switching
  • プログラム可能な HSDS、AC-LVPECL、LVDS、HSCL 形式による、12 の差動出力
    • 最大 16 つの合計周波数出力 (OUT0_P/N、OUT1 P/N、GPIO1、GPIO2 の 6 つの LVCMOS 周波数出力と、OUT2_P/N から OUT11_P/N までの 10 つの差動出力で構成した場合)
    • プログラム可能なスイングおよび同相モードによる 1Hz (1PPS)～1250MHz の出力周波数
    • PCIe Gen 1～6 準拠
  • I2C または 3 線式 / 4 線式 SPI
  • 超低ジッタ BAW VCO ベースの無線インフラとイーサネット クロック
    • 491.52MHz での RMS ジッタ 40fs (標準値) / 57fs (最大値)
    • 245.76MHz での RMS ジッタ 50fs (標準値) / 62fs (最大値)

  • 2 つのアナログ位相ロック ループ (APLL) による 2 つの高性能デジタル位相ロック ループ (DPLL)

    • 1mHz～4kHz にプログラム可能な DPLL ループ フィルタの帯域幅
    • 1ppt 未満の DCO 周波数調整ステップ サイズ
  • 2 差動またはシングルエンド DPLL 入力
    • 入力周波数：1Hz (1PPS) ～ 800MHz
    • デジタル Holdover および Hitless Switching
  • プログラム可能な HSDS、AC-LVPECL、LVDS、HSCL 形式による、12 の差動出力
    • 最大 16 つの合計周波数出力 (OUT0_P/N、OUT1 P/N、GPIO1、GPIO2 の 6 つの LVCMOS 周波数出力と、OUT2_P/N から OUT11_P/N までの 10 つの差動出力で構成した場合)
    • プログラム可能なスイングおよび同相モードによる 1Hz (1PPS)～1250MHz の出力周波数
    • PCIe Gen 1～6 準拠
  • I2C または 3 線式 / 4 線式 SPI

LMK5C22212AS1 は、無線通信およびインフラ アプリケーションの厳しい要件を満たすように設計された高性能ネットワーク シンクロナイザおよびジッタ クリーナです。

このデバイスは、IEEE-1588 PTP をプライマリ基準クロック ソースと同期するためのソフトウェア サポートがバンドルされたデバイスです。詳細については、テキサス・インスツルメンツにお問い合わせください。

ネットワーク シンクロナイザは、ループ帯域幅がプログラム可能で外部ループ フィルタを使用しないヒットレス スイッチングとジッタ減衰を実現するために、2 つの DPLL を内蔵しており、最大限の柔軟性と使いやすさを備えています。各 DPLL は、対になった APLL を DPLL リファレンス入力に位相固定します。

APLL1 は、BAW APLL として知られるテキサス・インスツルメンツ独自のバルク弾性波 (BAW) 技術を採用した超高性能 PLL を特長としており、XO および DPLL リファレンス入力のジッタにも周波数にも無関係に、45fs (標準値) / 60fs (最大値)、12kHz～20MHz RMS ジッタ (491.52MHz 時) で、出力クロックを生成できます。APLL2/DPLL2 には、2 番目の周波数および / また同期ドメインのオプションがあります。

リファレンス検証回路は、DPLL 基準クロックを監視し、スイッチオーバー イベントを検出すると入力間でヒットレス スイッチングを実行します。ゼロ遅延モード (ZDM) と位相キャンセルを有効にすることで、入力と出力の位相関係を制御できます。

本デバイスは、I2C または SPI インターフェイスを介して完全にプログラム可能です。内蔵 EEPROM を使用して、システムの起動クロックをカスタマイズできます。また、このデバイスには出荷時デフォルトの ROM プロファイルもフォールバック オプションとして用意されています。

LMK5C22212AS1 は、無線通信およびインフラ アプリケーションの厳しい要件を満たすように設計された高性能ネットワーク シンクロナイザおよびジッタ クリーナです。

このデバイスは、IEEE-1588 PTP をプライマリ基準クロック ソースと同期するためのソフトウェア サポートがバンドルされたデバイスです。詳細については、テキサス・インスツルメンツにお問い合わせください。

ネットワーク シンクロナイザは、ループ帯域幅がプログラム可能で外部ループ フィルタを使用しないヒットレス スイッチングとジッタ減衰を実現するために、2 つの DPLL を内蔵しており、最大限の柔軟性と使いやすさを備えています。各 DPLL は、対になった APLL を DPLL リファレンス入力に位相固定します。

APLL1 は、BAW APLL として知られるテキサス・インスツルメンツ独自のバルク弾性波 (BAW) 技術を採用した超高性能 PLL を特長としており、XO および DPLL リファレンス入力のジッタにも周波数にも無関係に、45fs (標準値) / 60fs (最大値)、12kHz～20MHz RMS ジッタ (491.52MHz 時) で、出力クロックを生成できます。APLL2/DPLL2 には、2 番目の周波数および / また同期ドメインのオプションがあります。

リファレンス検証回路は、DPLL 基準クロックを監視し、スイッチオーバー イベントを検出すると入力間でヒットレス スイッチングを実行します。ゼロ遅延モード (ZDM) と位相キャンセルを有効にすることで、入力と出力の位相関係を制御できます。

本デバイスは、I2C または SPI インターフェイスを介して完全にプログラム可能です。内蔵 EEPROM を使用して、システムの起動クロックをカスタマイズできます。また、このデバイスには出荷時デフォルトの ROM プロファイルもフォールバック オプションとして用意されています。
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* データシート LMK5C22212AS1 JESD204B/C および BAW 搭載、無線通信用、2 DPLL、2 APLL、2 入力、12 出力ネットワーク シンクロナイザ 、 IEEE-1588 PTP スタック内蔵、 データシート PDF | HTML 英語版 PDF | HTML 2024年 12月 9日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

設計ツール

CLOCK-PERFDATA-DESIGN — Clock performance data and register settings for clock generators, network synchronizers, jitter cleaners, and other clocking devices.

Configuration, raw phase noise data, noise plots, and register data for common use cases on clock generators, network synchronizers, jitter cleaners, and other clocking devices
サポート対象の製品とハードウェア

サポート対象の製品とハードウェア

製品
クロック ネットワーク シンクロナイザ
LMK5B33216 — 2.5GHz のバルク弾性波発振器 (BAW VCO) を内蔵し 16 出力、3 個の DPLL と APLL (デジタルとアナログの PLL) を採用したネットワーク シンクロナイザ LMK5B33414 — 2.5GHz のバルク弾性波発振器 (BAW VCO) を内蔵し 14 出力、3 個の DPLL と APLL (デジタルとアナログの PLL) を採用したネットワーク シンクロナイザ LMK5C33414AS1 — BAW VCO (バルク弾性波電圧制御発振器) 搭載、IEEE-1588 対応、3 個の DPLL (デジタル PLL)、3 個の APLL (アナログ PLL)、4 個の入力と 14 個の出力、ネッ LMK5C33414A — JESD204B/C 対応、BAW VCO (バルク弾性波電圧制御発振器) 搭載、3 個の DPLL (デジタル PLL)、3 個の APLL (アナログ PLL)、4 個の入力と 14 個の出力、ネ LMK5C33216A — JESD204B/C 対応、BAW VCO (バルク弾性波電圧制御発振器) 搭載、3 個の DPLL (デジタル PLL)、3 個の APLL (アナログ PLL)、2 個の入力と 16 個の出力、ネ LMK5C33216AS1 — BAW VCO (バルク弾性波電圧制御発振器) 搭載、IEEE-1588 対応、3 個の DPLL (デジタル PLL)、3 個の APLL (アナログ PLL)、2 個の入力と 16 個の出力、ネッ LMK5B12212 — 2.5GHz BAW VCO (バルク弾性波による電圧制御発振器) 内蔵、超低ジッタ、12 個の出力、1 個の DPLL、2 個の APLL ネットワーク シンクロナイザ LMK5C22212A — BAW VCO (バルク弾性波電圧制御発振器) 搭載、3 個の DPLL (デジタル PLL)、2 個の APLL (アナログ PLL)、2 個の入力と 12 個の出力、ネットワーク シンクロナイザ  LMK5C22212AS1 — BAW VCO (バルク弾性波電圧制御発振器) 搭載、IEEE-1588 対応、3 個の DPLL (デジタル PLL)、2 個の APLL (アナログ PLL)、2 個の入力と 12 個の出力、ネッ
ソフトウェア
アプリケーション・ソフトウェアとフレームワーク
TICSPRO-SW — テキサス インスツルメンツのクロックおよびシンセサイザ (TICS) プロ ソフトウェア
ダウンロードオプション
設計ツール

CLOCK-TREE-ARCHITECT — Clock tree architect プログラミング ソフトウェア

Clock tree architect はクロック ツリーの合成ツールであり、開発中システムの要件に基づいてクロック ツリー ソリューションを生成する方法で、お客様の設計プロセスの効率化に貢献します。このツールは、多様なクロック供給製品を収録した包括的なデータベースからデータを抽出し、システム レベルのマルチチップ クロック供給ソリューションを生成します。
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シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI を使用すると、内蔵のライブラリを使用して、複雑なミックスド (...)
リクエスト
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
VQFN (RGC) 64 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

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