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时钟网络同步器

LMK5C33414A

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具有 JESD204B/C 和 BAW VCO 的三 DPLL、三 APLL、四输入和 14 输出网络同步器

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产品详情

Function Clock network synchronizer Number of outputs 14 RMS jitter (fs) 47 Output frequency (min) (MHz) 0.000000000001 Output frequency (max) (MHz) 1250 Input type HCSL, LVCMOS, LVDS, LVPECL, XTAL Output type CML, LVCMOS, LVDS, LVPECL Supply voltage (min) (V) 3.135 Supply voltage (max) (V) 3.465 Features JESD204B Rating Catalog Operating temperature range (°C) -40 to 105 Number of input channels 4
Function Clock network synchronizer Number of outputs 14 RMS jitter (fs) 47 Output frequency (min) (MHz) 0.000000000001 Output frequency (max) (MHz) 1250 Input type HCSL, LVCMOS, LVDS, LVPECL, XTAL Output type CML, LVCMOS, LVDS, LVPECL Supply voltage (min) (V) 3.135 Supply voltage (max) (V) 3.465 Features JESD204B Rating Catalog Operating temperature range (°C) -40 to 105 Number of input channels 4
VQFN (RGC) 64 81 mm² 9 x 9
  • 基于 BAW VCO 的超低抖动无线时钟
    • 在 491.52MHz 下典型 RMS 抖动为 40fs，最大 RMS 抖动为 57fs
    • 在 245.76MHz 下典型 RMS 抖动为 50fs，最大 RMS 抖动为 62fs
  • 三个高性能数字锁相环 (DPLL) 与模拟锁相环 (APLL) 配对
    • 可编程 DPLL 环路带宽范围为 1mHz 至 4kHz
    • DCO 频率调节步长 < 1ppt
  • 四个差动或单端 DPLL 输入
    • 1Hz (1PPS) 至 800MHz 输入频率
    • 数字保持和无中断切换
  • 14 个采用可编程 HSDS、AC-LVPECL、LVDS 和 HSCL 格式的差动输出
    • 当在 OUT[1:0]_P/N、GPIO1 和 GPIO2 上配置 6 个 LVCMOS 频率输出并在 OUT[13:2]_P/N 上配置 12 个差动输出时，总共最多 18 个频率输出
    • 支持可编程摆幅和共模的 1Hz (1PPS) 至 1250MHz 输出频率
    • 符合 PCIe 第 1 代到第 6 代标准
  • I2C 三线制 SPI 或四线制 SPI
  • 工作温度：-40°C 至 85°C
  • 基于 BAW VCO 的超低抖动无线时钟
    • 在 491.52MHz 下典型 RMS 抖动为 40fs，最大 RMS 抖动为 57fs
    • 在 245.76MHz 下典型 RMS 抖动为 50fs，最大 RMS 抖动为 62fs
  • 三个高性能数字锁相环 (DPLL) 与模拟锁相环 (APLL) 配对
    • 可编程 DPLL 环路带宽范围为 1mHz 至 4kHz
    • DCO 频率调节步长 < 1ppt
  • 四个差动或单端 DPLL 输入
    • 1Hz (1PPS) 至 800MHz 输入频率
    • 数字保持和无中断切换
  • 14 个采用可编程 HSDS、AC-LVPECL、LVDS 和 HSCL 格式的差动输出
    • 当在 OUT[1:0]_P/N、GPIO1 和 GPIO2 上配置 6 个 LVCMOS 频率输出并在 OUT[13:2]_P/N 上配置 12 个差动输出时，总共最多 18 个频率输出
    • 支持可编程摆幅和共模的 1Hz (1PPS) 至 1250MHz 输出频率
    • 符合 PCIe 第 1 代到第 6 代标准
  • I2C 三线制 SPI 或四线制 SPI
  • 工作温度：-40°C 至 85°C

LMK5C33414A 是一款高性能网络同步器和抖动清除器，旨在满足无线通信和基础设施应用的严格要求。

器件集成了 3 个 DPLL 和 3 个 APLL，可通过可编程环路带宽 (LBW) 提供无中断切换和抖动衰减功能，具备一个外部环路滤波器，充分提升了灵活性和易用性。

APLL3 具有超高性能 PLL 和 TI 专有的体声波 (BAW) 技术。BAW APLL 可以生成 491.52MHz 输出时钟，其 RMS 抖动典型值为 40fs / 最大值为 60fs（12kHz 至 20MHz），而不受 DPLL 基准输入的频率和抖动特性的影响。APLL2 和 APLL1（传统 LC VCO）提供用于第二或第三频率域和/或同步域的选项。

基准验证电路会监测 DPLL 基准输入，并在检测到或丢失输入时自动执行无中断切换。零延迟模式 (ZDM) 可控制输入和输出之间的相位关系。

该器件可通过 I2C 或 SPI 进行全面编程。集成的 EEPROM 可用于自定义系统启动时钟。该器件还具有出厂默认的 ROM 配置文件作为备用选项。

LMK5C33414A 是一款高性能网络同步器和抖动清除器，旨在满足无线通信和基础设施应用的严格要求。

器件集成了 3 个 DPLL 和 3 个 APLL，可通过可编程环路带宽 (LBW) 提供无中断切换和抖动衰减功能，具备一个外部环路滤波器，充分提升了灵活性和易用性。

APLL3 具有超高性能 PLL 和 TI 专有的体声波 (BAW) 技术。BAW APLL 可以生成 491.52MHz 输出时钟，其 RMS 抖动典型值为 40fs / 最大值为 60fs（12kHz 至 20MHz），而不受 DPLL 基准输入的频率和抖动特性的影响。APLL2 和 APLL1（传统 LC VCO）提供用于第二或第三频率域和/或同步域的选项。

基准验证电路会监测 DPLL 基准输入，并在检测到或丢失输入时自动执行无中断切换。零延迟模式 (ZDM) 可控制输入和输出之间的相位关系。

该器件可通过 I2C 或 SPI 进行全面编程。集成的 EEPROM 可用于自定义系统启动时钟。该器件还具有出厂默认的 ROM 配置文件作为备用选项。
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* 数据表 适 用于无线通信和且具有 BAW VCO 和 JED204B/JED204C 的 4 路输入、14 路输出 LMK5C33414A 3-DPLL 3-APLL 网络同步器 数据表 (Rev. A) PDF | HTML 英语版 (Rev.A) PDF | HTML 2025年 3月 3日
用户指南 LMK5C33414A 编程人员指南 PDF | HTML 英语版 PDF | HTML 2025年 4月 21日
EVM 用户指南 LMK5C33414AEVM PDF | HTML 英语版 PDF | HTML 2024年 11月 18日

设计和开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

LMK5C33414AEVM — LMK5C33414A 评估模块

LMK5C33414A 评估模块 (EVM) 用于评估 LMK5C33414A 网络时钟发生器和同步器。该 EVM 可用于器件评估、合规性测试和系统原型设计。  LMK5C33414A 集成了三个模拟 PLL (APLL) 和三个具有可编程环路带宽的数字 PLL (DPLL)。该 EVM 包含针对时钟输入、振荡器输入和时钟输出的 SMA 连接器，以便将器件连接到 50Ω 测试设备。通过板载 TCXO，可在自由运行、锁定或保持模式下评估 LMK5C33414A。通过板载 USB 微控制器 (MCU) 接口，可在 PC 上使用 TICS Pro 软件图形用户界面 (GUI) 来配置该 (...)

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仿真模型

LMK5B33216 Family IBIS model

SNAM295.ZIP (239 KB) - IBIS Model
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设计工具

CLOCK-PERFDATA-DESIGN — Clock performance data and register settings for clock generators, network synchronizers, jitter cleaners, and other clocking devices.

Configuration, raw phase noise data, noise plots, and register data for common use cases on clock generators, network synchronizers, jitter cleaners, and other clocking devices
支持的产品和硬件

支持的产品和硬件

产品
时钟网络同步器
LMK5B33216 — 具有集成式 2.5GHz 体声波 VCO、16 路输出、三个 DPLL 和 APLL 的网络同步器 LMK5B33414 — 具有集成式 2.5GHz 体声波 VCO、14 路输出、三个 DPLL 和 APLL 的网络同步器 LMK5C33414AS1 — 具有 BAW VCO 和 IEEE-1588 支持的三 DPLL、三 APLL、四路输入和 14 路输出网络同步器 LMK5C33414A — 具有 JESD204B/C 和 BAW VCO 的三 DPLL、三 APLL、四输入和 14 输出网络同步器 LMK5C33216A — 具有 JESD204B/C 和 BAW VCO 的三 DPLL、三 APLL、两输入和 16 输出网络同步器 LMK5C33216AS1 — 具有 BAW VCO 和 IEEE-1588 支持的三 DPLL、三 APLL、双路输入和 16 路输出网络同步器 LMK5B12212 — 具有集成 2.5GHz BAW VCO、超低抖动、12 路输出、一个 DPLL、二个 APLL 的网络同步器 LMK5C22212A — 具有 BAW VCO 的三 DPLL、双 APLL、双路输入和 12 路输出网络同步器  LMK5C22212AS1 — 具有 BAW VCO 和 IEEE-1588/C 支持的三 DPLL、双 APLL、双路输入和 12 路输出网络同步器
软件
应用软件和框架
TICSPRO-SW — 德州仪器 (TI) 时钟和合成器 (TICS) Pro 软件
下载选项
模拟工具

PSPICE-FOR-TI — PSpice® for TI 设计和仿真工具

PSpice® for TI 可提供帮助评估模拟电路功能的设计和仿真环境。此功能齐全的设计和仿真套件使用 Cadence® 的模拟分析引擎。PSpice for TI 可免费使用，包括业内超大的模型库之一，涵盖我们的模拟和电源产品系列以及精选的模拟行为模型。

借助 PSpice for TI 的设计和仿真环境及其内置的模型库，您可对复杂的混合信号设计进行仿真。创建完整的终端设备设计和原型解决方案，然后再进行布局和制造，可缩短产品上市时间并降低开发成本。 

在 PSpice for TI 设计和仿真工具中，您可以搜索 TI (...)
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  • RoHS
  • REACH
  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/时基故障估算
  • 材料成分
  • 鉴定摘要
  • 持续可靠性监测
包含信息：
  • 制造厂地点
  • 封装厂地点

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