TIDA-01023

レーダー / 5G ワイヤレス テスタ向け、チャネル数の多い JESD204B クロック生成のリファレンス デザイン

TIDA-01023

設計ファイル

概要

高速マルチチャネル アプリケーションは、システムの SNR (信号対雑音比)、SFDR (スプリアス フリー ダイナミック レンジ)、ENOB (実効ビット数) を最適化するために、チャネル間スキューを正確に調整できる低ノイズでスケーラブルなクロッキング ソリューションが必要です。このリファレンス デザインは、1 つのマスタと複数のスレーブのクロック処理デバイスを使用して、チャネル数の多い、JESD204B に同期したクロックをサポートします。このデザインは、TI の LMK04828 クロック ジッタ クリーナ、および VCO を内蔵した LMX2594 広帯域 PLL を使用して、マルチチャネルの JESD204B クロックを実現し、10ps 未満のクロック間スキューを達成しています。このデザインは、TI の ADC12DJ3200 EVM を使用して 3GSPS でテスト済みで、SRN 性能の向上とともに 50ps 未満のチャネル間スキューが確認されています。すべての主要な設計理論が記載され、部品選択プロセスや設計の最適化の手引きとなります。回路図、基板レイアウト、ハードウェア テスト、テスト結果も付属しています。

特長
  • 高周波数 (GSPS) のサンプル クロック生成
  • チャネル数が多く、スケーラブルな JESD204B 準拠のクロック ソリューション
  • RF サンプリング ADC / DAC 向けの低位相ノイズ クロッキング
  • 構成可能な位相同期により、複数チャネル システムで低スキューを実現
  • TI の高速コンバータ カードとキャプチャ カード(ADC12DJ3200EVM、TSW14J56 / TSW14J57)をサポート
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組み立てられたボードは、テストと性能検証のみの目的で開発されたものであり、販売していません。

設計ファイルと製品

設計ファイル

すぐに使用できるシステム・ファイルをダウンロードすると、設計プロセスを迅速化できます。

JAJU463.PDF (1620 K)

リファレンス・デザインの概要と検証済みの性能テスト・データ

TIDRV50.PDF (1785 K)

設計レイアウトとコンポーネントを示した詳細な回路図

TIDRV51.PDF (1228 K)

設計レイアウトとコンポーネントを示した詳細な回路図

TIDRV52.PDF (193 K)

設計に使用したコンポーネント、参照指定子、メーカー名や型番などを記入した詳細なリスト

TIDRV53.PDF (94 K)

設計に使用したコンポーネント、参照指定子、メーカー名や型番などを記入した詳細なリスト

TIDRV54.PDF (1082 K)

コンポーネントの配置を明示する詳細な設計レイアウト

TIDRV55.PDF (644 K)

コンポーネントの配置を明示する詳細な設計レイアウト

TIDRV58.ZIP (17783 K)

IC コンポーネントの 3D モデルまたは 2D 図面に使用するファイル

TIDRV59.ZIP (7976 K)

IC コンポーネントの 3D モデルまたは 2D 図面に使用するファイル

TIDCED6.ZIP (6569 K)

PCB 設計の基板層に関する情報を記載した設計ファイル

TIDCED7.ZIP (2080 K)

PCB 設計の基板層に関する情報を記載した設計ファイル

TIDRV56.PDF (7468 K)

PCB 設計レイアウトを生成するための PCB 基板層のプロット・ファイル

TIDRV57.PDF (4389 K)

PCB 設計レイアウトを生成するための PCB 基板層のプロット・ファイル

製品

設計や代替製品候補に TI 製品を含めます。

AC/DC および DC/DC コンバータ (FET 内蔵)

TPS543182.95V ~ 6V 入力、3A、同期整流降圧 SWIFT™ コンバータ

データシート: PDF | HTML
AND ゲート

SN74LVC1G081 チャネル、2 入力、1.65V ~ 5.5V、32mA のドライブ能力、AND ゲート

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LVDS、M-LVDS、PECL の各 IC

DS90LV028AQ-Q1車載対応、LVDS デュアル差動ライン・レシーバ

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MOSFET

CSD15571Q22mm x 2mm の SON 封止、19.2mΩ、シングル、20V、N チャネル NexFET™ パワー MOSFET

データシート: PDF
RF PLL / シンセサイザ

LMX2594位相同期機能搭載、JESD204B サポート、15GHz 広帯域、PLLatinum™ RF シンセサイザ

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eFuse とホット・スワップ・コントローラ

TPS259254.5V ~ 5.5V、30mΩ、2 ~ 5A eFuse

データシート: PDF | HTML
アナログ・スイッチ / マルチプレクサ

SN74CBTLV3257部分的パワーダウン モード搭載、3.3V、2:1 (SPDT)、4 チャネル アナログ スイッチ

データシート: PDF | HTML
アナログ・スイッチ / マルチプレクサ

SN74LVC2G535V、2:1 (SPDT)、1 チャネル汎用アナログ・スイッチ (NanoFree™ パッケージが入手可能)

データシート: PDF | HTML
アナログ・スイッチ / マルチプレクサ

TMUX1574電源オフ保護機能搭載、1.8V 入力ロジック対応、5V、2:1 (SPDT)、4 チャネル アナログ スイッチ

データシート: PDF | HTML
クロック ジッタ クリーナ

LMK048282370 ~ 2630MHz の VCO0 内蔵、超低ノイズ、JESD204B 準拠クロック・ジッタ・クリーナ。

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クロック・バッファ

LMK003044 個の構成可能出力採用、3.1GHz、差動クロック バッファ / レベル シフタ

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デジタル温度センサ

LM95233TruTherm テクノロジー採用、SMBus インターフェイス搭載、±2℃、デュアル、リモート / ローカル温度センサ

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リニア・レギュレータと低ドロップアウト (LDO) レギュレータ

TLV702イネーブル搭載、300mA、高 PSRR、低静止電流 (IQ)、低ドロップアウト電圧レギュレータ

データシート: PDF | HTML
リニア・レギュレータと低ドロップアウト (LDO) レギュレータ

TPS7A47イネーブル搭載、1A、36V、低ノイズ、高 PSRR、低ドロップアウト電圧レギュレータ

データシート: PDF
リニア・レギュレータと低ドロップアウト (LDO) レギュレータ

TPS7A8300パワー・グッド搭載、高精度、低い入力電圧 (VIN)、低ノイズ、2A の超低ドロップアウト電圧レギュレータ

データシート: PDF | HTML
リニア・レギュレータと低ドロップアウト (LDO) レギュレータ

TPS7A90高精度、500mA、低ノイズ、高 PSRR、調整可能な超低ドロップアウト電圧レギュレータ

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発振器

LMK61E2超低ジジッタ、EEPROM プログラマブル発振器、医療用画像処理と試験/測定向け

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高速 ADC(≧10 MSPS)

ADC12DJ320012 ビット、デュアル 3.2GSPS またはシングル 6.4GSPS、RF サンプリング A/D コンバータ(ADC)

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ソフトウェア

技術資料

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すべて表示 2
種類 タイトル 英語版のダウンロード 日付
技術記事 Step-by-step considerations for designing wide-bandwidth multichannel systems PDF | HTML 2019年 6月 4日
設計ガイド レーダーおよび5Gワイヤレス・テスター用の、チャネル数の多い JESD204Bクロック生成のリファレンス・デザイン 英語版 2018年 1月 8日

関連する設計リソース

ハードウェア開発

評価ボード
ADC12DJ3200EVM ADC12DJ3200 12 ビット、デュアル 3.2GSPS またはシングル 6.4GSPS、RF サンプリング ADC の評価基板 LMK04828BEVM LMK04828 評価基板

リファレンス・デザイン

リファレンス・デザイン
TIDA-01021 DSO、レーダー、5G ワイヤレス・テスタ向けマルチチャネル JESD204B 15GHz クロックのリファレンス・デザイン TIDA-01022 DSO、レーダー、5G ワイヤレス・テスト・システム向けのフレキシブルな 3.2GSPS マルチチャネル AFE のリファレンス・デザイン TIDA-01024 レーダー / 5G ワイヤレス テスタ向け、チャネル数の多い JESD204B デイジーチェーン クロックのリファレンス デザイン

サポートとトレーニング

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