高速マルチチャネル アプリケーションは、システムの SNR (信号対雑音比)、SFDR (スプリアス フリー ダイナミック レンジ)、ENOB (実効ビット数) を最適化するために、チャネル間スキューを正確に調整できる低ノイズでスケーラブルなクロッキング ソリューションが必要です。このリファレンス デザインは、JESD204B に同期したクロックをデイジーチェーン構成でスケーリングできます。このデザインは、TI の LMK04828 クロック ジッタ クリーナ、および VCO を内蔵した LMX2594 広帯域 PLL を使用して、マルチチャネルの JESD204B クロックを実現し、10ps 未満のクロック間スキューを達成しています。このデザインは、TI の ADC12DJ3200 EVM を使用して 3GSPS でテスト済みで、SRN 性能の向上とともに 50ps 未満のチャネル間スキューが確認されています。すべての主要な設計理論が記載され、部品選択プロセスや設計の最適化の手引きとなります。回路図、基板レイアウト、ハードウェア テスト、テスト結果も付属しています。
組み立てられたボードは、テストと性能検証のみの目的で開発されたものであり、販売していません。
すぐに使用できるシステム ファイルをダウンロードすると、設計プロセスを迅速化できます。
設計に使用したコンポーネント、参照指定子、メーカー名や型番などを記入した詳細なリスト
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| タイプ | タイトル | 最新の英語版をダウンロード | 日付 | |||
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| * | 設計ガイド | レーダーおよび5Gワイヤレス・テスター用の、チャネル数の多い JESD204Bデイジー・チェーン・クロックのリファレンス・デザイン | 英語版 | 2018/01/11 | ||
| 技術記事 | Step-by-step considerations for designing wide-bandwidth multichannel systems | PDF | HTML | 2019/06/04 |