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ADC12QJ1600-SP

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耐辐射加固保障 (RHA)、300krad、12 位、四通道、1.6GSPS ADC

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ADC12QJ1600-SP

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产品详情

Sample rate (max) (Msps) 1600 Resolution (Bits) 12 Number of input channels 4 Interface type JESD204B, JESD204C Analog input BW (MHz) 6000 Features Ultra High Speed Rating Space Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 1910 Architecture Folding Interpolating SNR (dB) 57.4 ENOB (Bits) 9 SFDR (dB) 64 Operating temperature range (°C) -55 to 125 Input buffer Yes Radiation, TID (typ) (krad) 300 Radiation, SEL (MeV·cm2/mg) 120
Sample rate (max) (Msps) 1600 Resolution (Bits) 12 Number of input channels 4 Interface type JESD204B, JESD204C Analog input BW (MHz) 6000 Features Ultra High Speed Rating Space Peak-to-peak input voltage range (V) 0.8 Power consumption (typ) (mW) 1910 Architecture Folding Interpolating SNR (dB) 57.4 ENOB (Bits) 9 SFDR (dB) 64 Operating temperature range (°C) -55 to 125 Input buffer Yes Radiation, TID (typ) (krad) 300 Radiation, SEL (MeV·cm2/mg) 120
FCCSP (ALR) 144 100 mm² 10 x 10
  • 辐射性能：
    • 电离辐射总剂量 (TID)：300krad (Si)
    • 单粒子锁定 (SEL)：120MeV-cm2/mg
    • 单粒子翻转 (SEU) 抗扰度寄存器
  • ADC 内核：
    • 分辨率：12 位
    • 最大采样率：1.6GSPS
    • 非交错式架构
    • 内部抖动可减少高次谐波
  • 性能规格 (–1dBFS)：
    • SNR (100MHz)：57.4dBFS
    • ENOB (100MHz)：9.1 位
    • SFDR (100MHz)：64dBc
    • 本底噪声 (–20dBFS)：–147dBFS
  • 满量程输入电压：800mVPP-DIFF
  • 全功率输入带宽：6GHz
  • JESD204C 串行数据接口：
    • 总共支持 2 至 8 个串行器/解串器通道
    • 最大波特率：17.16Gbps
    • 64B/66B 和 8B/10B 编码模式
    • 子类 1 支持确定性延迟
    • 与 JESD204B 接收器兼容
  • 可选的内部采样时钟生成
    • 内部 PLL 和 VCO (7.2–8.2GHz)
  • SYSREF 窗口可简化同步
  • 四个时钟输出可简化系统时钟
    • FPGA 或相邻 ADC 的参考时钟
    • 串行器/解串器收发器的参考时钟
  • 脉冲系统的时间戳输入和输出
  • 功耗 (1GSPS)：1.9W
  • 电源：1.1V、1.9V
  • 辐射性能：
    • 电离辐射总剂量 (TID)：300krad (Si)
    • 单粒子锁定 (SEL)：120MeV-cm2/mg
    • 单粒子翻转 (SEU) 抗扰度寄存器
  • ADC 内核：
    • 分辨率：12 位
    • 最大采样率：1.6GSPS
    • 非交错式架构
    • 内部抖动可减少高次谐波
  • 性能规格 (–1dBFS)：
    • SNR (100MHz)：57.4dBFS
    • ENOB (100MHz)：9.1 位
    • SFDR (100MHz)：64dBc
    • 本底噪声 (–20dBFS)：–147dBFS
  • 满量程输入电压：800mVPP-DIFF
  • 全功率输入带宽：6GHz
  • JESD204C 串行数据接口：
    • 总共支持 2 至 8 个串行器/解串器通道
    • 最大波特率：17.16Gbps
    • 64B/66B 和 8B/10B 编码模式
    • 子类 1 支持确定性延迟
    • 与 JESD204B 接收器兼容
  • 可选的内部采样时钟生成
    • 内部 PLL 和 VCO (7.2–8.2GHz)
  • SYSREF 窗口可简化同步
  • 四个时钟输出可简化系统时钟
    • FPGA 或相邻 ADC 的参考时钟
    • 串行器/解串器收发器的参考时钟
  • 脉冲系统的时间戳输入和输出
  • 功耗 (1GSPS)：1.9W
  • 电源：1.1V、1.9V

ADC12QJ1600-SP 是一款四通道、12 位、1.6GSPS 模数转换器 (ADC)。该器件具有低功耗、高采样率和 12 位分辨率，适合用于各种多通道通信系统。

6GHz 的全功率输入带宽 (-3dB) 还支持 L 频带和 S 频带的直接射频采样。

包含许多时钟功能以放宽系统硬件要求，例如带有集成压控振荡器 (VCO) 的内部锁相环 (PLL)，用于生成采样时钟。提供了四个时钟输出，以便对 FPGA 或 ASIC 的逻辑和串行器/解串器进行计时。为脉冲系统提供了时间戳输入和输出。

JESD204C 串行接口通过减少印刷电路板 (PCB) 布线量来减小系统尺寸。接口模式支持 2 至 8 个通道（双通道和四通道器件）或 1 至 4 个通道（单通道器件）和高达 17.16Gbps 的串行器/解串器波特率，从而使每个应用能够实现最佳配置。

ADC12QJ1600-SP 是一款四通道、12 位、1.6GSPS 模数转换器 (ADC)。该器件具有低功耗、高采样率和 12 位分辨率，适合用于各种多通道通信系统。

6GHz 的全功率输入带宽 (-3dB) 还支持 L 频带和 S 频带的直接射频采样。

包含许多时钟功能以放宽系统硬件要求，例如带有集成压控振荡器 (VCO) 的内部锁相环 (PLL)，用于生成采样时钟。提供了四个时钟输出，以便对 FPGA 或 ASIC 的逻辑和串行器/解串器进行计时。为脉冲系统提供了时间戳输入和输出。

JESD204C 串行接口通过减少印刷电路板 (PCB) 布线量来减小系统尺寸。接口模式支持 2 至 8 个通道（双通道和四通道器件）或 1 至 4 个通道（单通道器件）和高达 17.16Gbps 的串行器/解串器波特率，从而使每个应用能够实现最佳配置。
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如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

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ADC12QJ1600EVM — ADC12QJ1600 具有 JESD204C 接口的四通道 12 位 1.6GSPS ADC 评估模块

ADC12QJ1600 评估模块 (EVM) 用于评估 ADC12QJ1600-Q1 系列高速模数转换器 (ADC)。该 EVM 装配了 ADC12QJ1600-Q1，后者是一款具有 JESD204B 接口的 12 位四通道 1.6GSPS ADC，可评估 12 位系列中的所有采样率和单通道、双通道和四通道汽车类或工业级器件。
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评估板

TSW12QJ1600EVM — ADC12QJ1600-Q1 8 通道（两个同步 4 通道）12 位 1.6GSPS JESD204C 接口 ADC 评估模块

TSW12QJ1600 评估模块 (EVM) 用于评估具有不同前端选项的 ADC12QJ1600-Q1 系列高速模数转换器 (ADC)。该 EVM 装配了双通道 ADC12QJ1600-Q1（一个具有 JESD204B 接口的 12 位四通道 1.6GSPS ADC），可评估多个 ADC 同步和确定性延迟，并使用各种前端选项（交流耦合变压器；具有 LMH32401 的直流耦合选项）测试 ADC 的性能。该设计还展示了如何通过从一个 ADC 到另一个 ADC 菊链式连接 PLL 基准输出（PLLREFO+、PLLREFO-）来简化时钟方案，无需采用 JESD 器件通常需要的时钟分配芯片。
用户指南: PDF
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ADC12QJ1600 IBIS-AMI Model

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