PMP22165
AMD (旧 Xilinx) Versal ACAP (Adaptive Compute Acceleration Platform) 向け電源のリファレンス デザイン
PMP22165
概要
このリファレンス デザインは、ザイリンクス Versal アダプティブ コンピュート アクセラレーション プラットフォーム (ACAP) の要件に対応し、システム レール用の電源管理集積回路 (PMIC) と、より高い電流のプロセッサ負荷をサポートするための多相コントローラおよび電源ステージで構成されています。 クリティカルな出力にオンボードのダイナミック ロードを搭載することで、ザイリンクスの厳しい電力要件に対応したテストが可能になります。PMP22165とTPS53681 EVMは、Versalの最も一般的なユースケース1および3のプロセッサ要件を満たすコンポーネントを備えた性能を提供するテスト済みソリューションです。
特長
- 10 レールのユーザー プログラマブル TPS650861 PMIC は、システム レベルの電力と、設計で使用するシーケンス全体の両方を管理
- Versal の非常に一般的な使用事例 1 と 3 に対応する、システム全体を対象とする電源ソリューション
- 公称出力電圧の供給時に 92% のピーク効率を達成できるように最適化済みの電力段の組み合わせ
- 複数の重要な出力は、動的負荷対応機能をオンボード搭載
出力電圧オプション | PMP22165.1 | PMP22165.2 | PMP22165.3 | PMP22165.4 | PMP22165.5 | PMP22165.6 | PMP22165.7 | PMP22165.8 | PMP22165.9 |
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Vin(最小)(V) | 7 | 7 | 1.5 | 7 | 3.2 | 3.3 | 3.2 | 3.2 | 7 |
Vin(最大)(V) | 14 | 14 | 1.5 | 14 | 3.4 | 3.3 | 3.4 | 3.4 | 14 |
Vout (Nom) (V) | 3.3 | 1.5 | 1.5 | 1.2 | .88 | 3.3 | 2.5 | 1.1 | .8 |
Iout(最大)(V) | 4 | 4 | .2 | 4.8 | 3.1 | .5 | .5 | .5 | 165 |
出力電力(W) | 13.2 | 6 | .3 | 5.76 | 2.728 | 1.65 | 1.25 | .55 | 132 |
絶縁/非絶縁 | Non-Isolated | Non-Isolated | Non-Isolated | Non-Isolated | Non-Isolated | Non-Isolated | Non-Isolated | Non-Isolated | Non-Isolated |
入力タイプ | DC | DC | DC | DC | DC | DC | DC | DC | DC |
トポロジ | Buck- Synchronous | Buck- Synchronous | Other | Buck- Synchronous | Buck- Synchronous | Other | Buck- Synchronous | Buck- Synchronous | Buck- Multiphase |
組み立てられたボードは、テストと性能検証のみの目的で開発されたものであり、販売していません。
設計ファイルと製品
設計ファイル
すぐに使用できるシステム ファイルをダウンロードすると、設計プロセスを迅速化できます。
TIDM601.PDF (334 KB)
設計に使用したコンポーネント、参照指定子、メーカー名や型番などを記入した詳細なリスト
製品
設計や代替製品候補に TI 製品を含めます。
開発の開始
計算ツール
The design resource accessed as www.ti.com/lit/zip/tidcfv1 or www.ti.com/lit/xx/tidcfv1/tidcfv1.zip has been migrated to a new user experience at www.ti.com/tool/jp/download/TIDCFV1. Please update any bookmarks accordingly.
技術資料
=
TI が選定した主要ドキュメント
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タイプ | タイトル | 最新の英語版をダウンロード | 日付 | |||
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* | 試験報告書 | Power for Xilinx Versal Adaptive Compute Acceleration Platform Reference Design | 2020/05/14 |