PMP20859

スムーズな遷移を実現する デュアル入力、冗長型 PoE PD のリファレンス デザイン

概要

このリファレンス デザインは、IEEE802.3bt (ドラフト) に準拠したPower over Ethernet (PoE) 受電デバイス(PD) を実装しており、2 系統の冗長入力と、それらの入力および補助入力間でのスムーズな切り替えを可能にします。  このデザインは、5V/6A の同期フライバック コンバータで構成されており、最大 3 つの電源 (2 つの PoE 給電装置 (PSE) と1 つの AC/DC ウォール アダプタの補助電源) を使用できるため、システムにおける電力およびデータ損失のリスクを低減します。

IEEE802.3bt 対応 PSE コントローラの必要性をお考えですか?TPS23881を確認してください。

特長
  • 冗長化入力:  2 つの PoE および 48V アダプタ
  • 入力を切り替える際も出力は連続して供給
  • PoE 入力時、5V/6A 出力で 84% の変換効率を実現
出力電圧オプション PMP20859.1
Vin (Min) (V) 42.5
Vin (Max) (V) 57
Vout (Nom) (V) 5
Iout (Max) (A) 6
Output Power (W) 30
Isolated/Non-Isolated Isolated
Input Type DC
Topology Flyback- Synchronous^POE
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組み立てられたボードは、テストと性能検証のみの目的で開発されたものであり、販売していません。

設計ファイルと製品

設計ファイル

すぐに使用できるシステム・ファイルをダウンロードすると、設計プロセスを迅速化できます。

TIDT030.PDF (1112 K)

効率グラフや試験の前提条件などを含める、このリファレンス・デザインに関する試験結果

TIDRX94.PDF (430 K)

設計レイアウトとコンポーネントを示した詳細な回路図

TIDRX95.PDF (40 K)

設計に使用したコンポーネント、参照指定子、メーカー名や型番などを記入した詳細なリスト

TIDRX96.PDF (417 K)

コンポーネントの配置を明示する詳細な設計レイアウト

TIDRX98.ZIP (1410 K)

IC コンポーネントの 3D モデルまたは 2D 図面に使用するファイル

TIDCEX3.ZIP (1594 K)

PCB 設計の基板層に関する情報を記載した設計ファイル

TIDRX97.PDF (2119 K)

PCB 設計レイアウトを生成するための PCB 基板層のプロット・ファイル

製品

設計や代替製品候補に TI 製品を含めます。

AC/DC と DC/DC の各コントローラ (外部 FET)

LM502013 ~ 100V の広い入力電圧範囲 (Vin)、電流モード PWM、昇圧 / フライバック / SEPIC コントローラ

データシート: PDF
MOSFET

CSD18504Q5A5mm x 6mm のシングル SON 封止、6.6mΩ、40V、N チャネル NexFET™ パワー MOSFET

データシート: PDF | HTML
MOSFET

CSD19534Q5A5mm x 6mm の SON 封止、シングル、15.1mΩ、100V、N チャネル NexFET™ パワー MOSFET

データシート: PDF | HTML
MOSFET

CSD19538Q3A3mm x 3mm の SON 封止、シングル、61mΩ、100V、N チャネル NexFET™ パワー MOSFET

データシート: PDF | HTML
シャント電圧リファレンス

TLV431A1% 精度、低電圧、調整可能な高精度シャント レギュレータ

データシート: PDF | HTML
スーパーバイザとリセット IC

TPS3808プログラマブル遅延機能と手動リセット機能搭載、低静止電流スーパーバイザ

データシート: PDF | HTML
電力受電側

TPS2372自動 MPS / AutoClass 機能搭載 IEEE 802.3bt PoE 大出力 PD インターフェイス

データシート: PDF | HTML

技術資料

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種類 タイトル 英語版のダウンロード 日付
* 試験報告書 Dual-Input Redundant PoE PD With Smooth Transition Reference Design 2018年 10月 21日

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