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  • 2단계 필터를 사용하여 전압 리플 감소

    • KOKT008 january   2023 TPS543B22 , TPS548A28 , TPS56121

       

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  • 2단계 필터를 사용하여 전압 리플 감소
  1.   1
  2. 1 머리말
  3. 2 애플리케이션의 선택 및 제한
  4. 3 2차 단계 필터 설계하기
  5. 4 전압 모드 제어 아키텍처
  6. 5 D-CAP3 제어 아키텍처
  7. 6 ACM(고급 전류 모드) 제어 아키텍처
  8. 7 효율성 페널티
  9. 8 결론
  10. 9 참고 문헌
  11. 10관련 웹사이트
  12. IMPORTANT NOTICE
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Analog Design Journal

2단계 필터를 사용하여 전압 리플 감소

이 리소스는 원래 영어로 작성되었습니다. 이 번역은 편의를 위해 자동화 도구가 포함되었을 수 있는 방법을 사용하여 제공되는 것이며, TI는 번역의 정확성을 보장하지 않습니다. 항상 ti.com의 최신 영어 버전(이 버전을 우선함)를 참조하여 정확성을 확인하세요.

1 머리말

점대점 직렬 통신 또는 AFE(아날로그 프런트 엔드)가 결합되어 있는 고급 프로세서 및 SoC(시스템 온 칩)에는 신호 무결성을 유지하고 성능을 개선하기 위해 낮은 출력 전압 리플을 갖춘 전원 공급 장치가 필요합니다. 프로세서 POL(Point-of-Load) 전원 공급 장치의 출력 전압 리플 요구 사항은 일반적인 설계 리플의 약 10분의 1에 해당되는 2mV 미만이 될 수 있기 때문에 동기식 벅 컨버터에 상당한 설계 제약이 가해집니다. 프로세서의 출력 전류 요구 사항이 선형 포스트 레귤레이터의 능력 범위를 초과하기 때문에 2차 단계 필터를 사용하면 더 높은 스위칭 주파수와 추가 출력 정전 용량으로 POL의 리플이 크게 줄어듭니다. 동기식 벅 컨버터는 여러 다양한 제어 아키텍처와 함께 사용할 수 있으며, 각 아키텍처별로 저리플 전압용으로 설계할 때 안정성을 보장하는 고유한 방법을 가지고 있습니다. 이 글에서는 외부 보상 전압 모드, 정전류 및 선택 가능한 보상 전류 모드의 세 가지 제어 아키텍처를 비교하여 동일한 전기 사양을 사용하고 출력 전압 리플, 솔루션 크기, 부하 과도현상 및 효율성 비교를 사용하여 테스트 데이터를 통해 완벽한 1mV 출력 전압 리플을 달성합니다.

 

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