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  • DS90LV048A 3V LVDSクワッドCMOS差動ライン・レシーバ

    • JAJS617C July   1999  – July 2016 DS90LV048A

      PRODUCTION DATA.  

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  • DS90LV048A 3V LVDSクワッドCMOS差動ライン・レシーバ
  1. 1 特長
  2. 2 アプリケーション
  3. 3 概要
  4. 4 改訂履歴
  5. 5 Pin Configuration and Functions
  6. 6 Specifications
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 ESD Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information
    5. 6.5 Electrical Characteristics
    6. 6.6 Switching Characteristics
    7. 6.7 Typical Characteristics
  7. 7 Parameter Measurement Information
  8. 8 Detailed Description
    1. 8.1 Overview
    2. 8.2 Functional Block Diagram
    3. 8.3 Feature Description
      1. 8.3.1 Fail-Safe Feature
    4. 8.4 Device Functional Modes
  9. 9 Application and Implementation
    1. 9.1 Application Information
    2. 9.2 Typical Application
      1. 9.2.1 Design Requirements
      2. 9.2.2 Detailed Design Procedure
        1. 9.2.2.1 Probing LVDS Transmission Lines
        2. 9.2.2.2 Threshold
      3. 9.2.3 Application Curve
  10. 10Power Supply Recommendations
  11. 11Layout
    1. 11.1 Layout Guidelines
      1. 11.1.1 Power Decoupling Recommendations
      2. 11.1.2 Differential Traces
      3. 11.1.3 Termination
    2. 11.2 Layout Example
  12. 12デバイスおよびドキュメントのサポート
    1. 12.1 ドキュメントのサポート
      1. 12.1.1 関連資料
    2. 12.2 ドキュメントの更新通知を受け取る方法
    3. 12.3 コミュニティ・リソース
    4. 12.4 商標
    5. 12.5 静電気放電に関する注意事項
    6. 12.6 Glossary
  13. 13メカニカル、パッケージ、および注文情報
  14. 重要なお知らせ
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DATA SHEET

DS90LV048A 3V LVDSクワッドCMOS差動ライン・レシーバ

このリソースの元の言語は英語です。 翻訳は概要を便宜的に提供するもので、自動化ツール (機械翻訳) を使用していることがあり、TI では翻訳の正確性および妥当性につきましては一切保証いたしません。 実際の設計などの前には、ti.com で必ず最新の英語版をご参照くださいますようお願いいたします。

1 特長

  • 400Mpbs (200MHz)を超えるスイッチング速度
  • フロースルーのピン配置によりPCBレイアウトを簡素化
  • チャネル間スキュー: 150ps (標準値)
  • 差動スキュー: 100ps (標準値)
  • 最大伝搬遅延: 2.7ns
  • 3.3V電源の設計
  • 電源オフ時にLVDS入力が高インピーダンス
  • 低消費電力の設計(3.3V静的で40mW)
  • 既存の5V LVDSドライバと相互運用可能
  • 小振幅(標準値350mV)の差動信号レベルを許容
  • 入力フェイルセーフのサポート
    • オープン、短絡、および終端
  • 0V～−100mVのスレッショルド領域
  • ANSI/TIA/EIA-644規格に準拠
  • 動作温度範囲: -40℃～85℃
  • SOICおよびTSSOPパッケージで利用可能

2 アプリケーション

  • マルチファンクションのプリンタ
  • LVDS - LVCMOS変換

3 概要

DS90LV048Aデバイスは、クワッドCMOSフロースルー差動ライン・レシーバで、非常に低い消費電力と高いデータ速度を必要とするアプリケーション用に設計されています。このデバイスは、低電圧差動信号(LVDS)テクノロジを活用し、400Mbps (200MHz)を超えるデータ転送速度をサポートするよう設計されています。

DS90LV048Aは低電圧(標準値350mV)の差動入力信号を受け付け、3V CMOS出力レベルへ変換します。レシーバはTRI-STATE機能をサポートしており、出力の多重化に使用できます。また、レシーバはオープン、短絡、終端(100Ω)の入力フェイルセーフもサポートします。すべてのフェイルセーフ条件において、レシーバの出力はHIGHになります。DS90LV048Aはフロースルーのピン配置を採用しているため、PCBレイアウトが簡単になります。

ENおよびEN*入力は互いにAND接続され、TRI-STATE出力を制御します。イネーブルは4つのレシーバすべてに共通です。DS90LV048AおよびコンパニオンLVDSライン・ドライバ(例: DS90LV047A)は、大電力のPECL/ECLデバイスの新しい代替品として、高速のポイント・ツー・ポイント・インターフェイス・アプリケーションに使用できます。

製品情報(1)

型番 パッケージ 本体サイズ(公称)
DS90LV048A SOIC (16) 9.90mm×3.91mm
TSSOP (16) 5.00mm×4.40mm
  1. 提供されているすべてのパッケージについては、データシートの末尾にある注文情報を参照してください。

機能図

DS90LV048A 10088802.png

4 改訂履歴

Changes from B Revision (April 2013) to C Revision

  • 「ESD定格」の表、「熱に関する情報」セクション、「機能説明」セクション、「デバイスの機能モード」セクション、「アプリケーションと実装」セクション、「電源に関する推奨事項」セクション、「レイアウト」セクション、「デバイスおよびドキュメントのサポート」セクション、「メカニカル、パッケージ、および注文情報」セクションを追加Go

Changes from A Revision (April 2013) to B Revision

  • Changed layout of National Semiconductor Data Sheet to TI formatGo

5 Pin Configuration and Functions

D or PW Package
16-Pin SOIC or TSSOP
Top View
DS90LV048A 10088801.png

Pin Functions

PIN I/O DESCRIPTION
NAME NO.
EN 16 I Receiver enable pin: When EN is low, the receiver is disabled. When EN is high and EN* is low or open, the receiver is enabled. If both EN and EN* are open circuit, then the receiver is disabled.
EN* 9 I Receiver enable pin: When EN* is high, the receiver is disabled. When EN* is low or open and EN is high, the receiver is enabled. If both EN and EN* are open circuit, then the receiver is disabled.
GND 12 — Ground pin
RIN+ 2, 3, 6, 7 I Noninverting receiver input pin
RIN− 1, 4, 5, 8 I Inverting receiver input pin
ROUT 10, 11, 14, 15 O Receiver output pin
VCC 13 — Power supply pin, +3.3V ± 0.3V

 
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